随着现代芯片的复杂性不断提高，验证成为芯片设计过程中最耗时和费力的部分，许多芯片设计项目通常要耗费大约 60%-80% 的项目资源 用于验证 ，并且 还成为了 整个 设计 过程中的瓶颈 ，能否顺利完成验证成为了决定芯片上市时间（ TTM）和项目整体成本的关键 。正是因为这样的复杂性和重要性， 采用验证 IP（ VIP）等工具，并 与值得信赖的IP 伙伴合作是回报最高的途径， 这将帮助 芯片设计师解决过程中遇到的问题。

专业的验证 IP 可以显著地增加验证覆盖范围，可 提前探知 极端情况，并可显著地减少设置仿真系统所需的总体工作量（例如，创建模拟刺激）。 所以，无论您是为下一个 SoC 、 ASIC 或 FPGA 项目 寻找设计IP ，还是寻找验证解决方案来 确认 您的芯片设计， 全球领先的 IP 提供商 SmartDV 都可以迅速而可靠地 利用其 庞大的 IP 产品组合， 或者根据您独特的需求生成定制 IP ，来全面 满足 设计项目 的需求。

什么是验证 I P （ V IP ）？

验证 I P （ VIP ）   是预先设计的验证组件和测试台，用于验证IP 核和 芯片 设计的功能和性能 。 验证IP 是一种特殊的 IP 核，它将给定接口的总线功能模型（ BFM ）的功能与测试台中使用的测试用例框架功能相结合 。 验证IP 是一个可重复使用的 IP 核，可用于创建必要的 完整的测试用例和测试台 ，以缩短SoC 验证时间并增加覆盖率。虽然验证 IP 通常用于验证标准总线协议，但它也可用于系统性能分析，并且越来越多地用于模拟、仿真和虚拟原型设计。

SmartDV 在验证 IP 领域具有悠久的历史和丰富的经验，能够提供 业 内最全面的、覆盖多种协议的验证 IP ，同时还可以利用其特殊的工具和完整的协议和标准团队生成面向特定应用的验证 IP 。目前 SmartDV 已向包括全球领先半导体公司在内的数百家芯片设计公司提供了各种 VIP 产品，并得到了用户的广泛欢迎，成功地帮助他们加速了各种规模的芯片设计，并提高了芯片设计的质量 。

S martDV 特有的验证 IP 与设计 IP 生产工具组合

SmartDV 不仅拥有一直精通各种协议和标准的 IP 专家，而且还打造 了专门的 IP 生产工具 组合 ， 公司的专业工程师利用这些工具就可以生产各种设计 IP 和验证 IP ，并可以实现定制 IP 的生成，从而 帮助芯片设计师更轻松、更快速地将我们的IP 整合到他们的 ASIC 、 SoC 和 FPGA 中。 其 IP 生产工具组合包括：

SmartCompiler

SmartDV 产品目录中的每一个 IP 都是使用我们的 SmartCompiler™ 生成的。多年来，我们一直在磨砺这项功能强大且极为可靠的专有技术，以创建和定制 IP 。这是我们商业模式的核心竞争力！

它的工作机制是一个严格保护的商业秘密 ——但我们将这一独一无二的编译器的强大功能用来支持我们的客户，无论您是用于 IP 定制，还是想要定制化的 IP 开发。对我们在全球的数百家客户来说，我们提供的定制 IP 已经为其带来了更强的竞争力和更高的毛利。

SmartVIPDebug

SmartVIPDebug™ 工具通过先进的行业标准波形和表格化交互视图，提供快速的分析和调试。 该工具加快了对协议违规行为的检测速度，并使用户能够在没有特定协议专家的情况下进行故障排除。

SmartVIPDebug 支持多种验证环境（仿真、模拟、 SystemC ），并提供高质量的文档，以减少上手时间。

SmartTestBench

SmartTestBench ™ 自动化生成 testbench 文件，消除了繁琐、耗时的手动创建过程。 该工具可以在系统 Verilog 、 UVM 、 OVM 和 SystemC 中创建 testbench 文件。它与所有 VIP 许可证一起提供，帮助您充分利用从 SmartDV 获得的技术。

SmartDV 提供哪些 V IP ？

SmartDV 的 V IP 是由具有数十年复杂芯片验证经验的验证工程师所创建。我们还为各种应用提供基于标准的设计 I P 。下面显示的是我们提供的一些 I P 核。

SmartDV 提供广泛且多样化的半导体 IP 产品和验证解决方案，涵盖 5G 、航空、航天、汽车、移动、网络、串行总线、存储和视频 / 显示等多个领域。全球数千位芯片设计师信赖 SmartDV 提供的经过验证和易于集成的 IP ，他们可以轻松地把这些 IP 集成到其 SoC 、 ASIC 和 FPGA 中并高质量地完成其项目。

即刻与我们的团队联系，探讨多种可能性。访问以下链接，在我们的联系页面上给我们留言，或者发邮件到  ChinaSales@smart-IP.cn

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