2026 年 5 月 25 日，在 IEEE 国际电路与系统研讨会（ISCAS 2026）上，华为提出了名为“韬（τ）定律（Tau Law）”的新型半导体演进理念。

在全球半导体逐渐进入“后摩尔时代”的背景下，这一概念被视为华为针对未来芯片发展方向提出的一种全新思路。

与传统依赖“缩小晶体管尺寸”的路线不同，“韬定律”更强调通过降低系统时延（τ）来提升整体性能，其核心目标是：

让芯片运行更快、响应更低延迟，而不仅仅是把晶体管做得更小。

一、从“尺寸竞争”转向“时间优化”

过去数十年，半导体行业一直遵循“摩尔定律”发展：

通过不断缩小晶体管尺寸，实现性能提升和功耗下降。 例如：

14nm

7nm

5nm

3nm

都是这一逻辑下的产物。

但随着先进制程逐渐接近物理极限，行业开始面临：

制造成本大幅上升

功耗与散热压力增加

工艺复杂度提升

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在这样的背景下，“韬定律”提出了新的方向：

即使制程尺寸无法继续大幅缩小，也可以通过优化信号传输效率与系统协同能力，持续提升芯片性能。

其中，“τ（Tau）”在电子工程中代表时间常数，可理解为：

信号延迟

响应时间

数据传输等待时间

因此，“韬定律”的本质是：

以“降低时延”为核心目标的系统级优化路线。

二、核心技术方向：降低延迟的两条路径

1. 逻辑折叠（Logic Folding）

这是“韬定律”中最受关注的概念之一。

传统芯片电路通常在二维平面展开，而“逻辑折叠”则尝试通过三维堆叠方式，将原本分散的模块更紧密地组织在一起。

这样做的优势包括：

缩短信号传输距离

提高数据交换效率

降低延迟

提升单位面积性能

从行业角度来看，这一路线与当前先进封装和 3D 堆叠技术存在相似之处，例如：

AMD 3D V-Cache

Intel Foveros

台积电 CoWoS

因此，不少业内人士认为：

“逻辑折叠”更像是对现有先进封装理念的进一步系统化与工程化。

2. 全栈协同优化

相比单纯提升芯片制程，“韬定律”更强调：

从底层硬件到上层软件的整体协同。

优化范围包括：

晶体管结构

电路设计

芯片架构

封装技术

操作系统

AI 调度

云端协同

其目标是让整个系统围绕“低时延”统一优化，而不是只追求单点性能参数。

三、战略意义：后摩尔时代的新路径

在全球半导体竞争加剧、先进制造设备受限的背景下，“韬定律”也被视为一种“换道发展”的尝试。

其核心思路是：

通过架构设计、封装创新与系统协同，在成熟或次先进制程基础上，实现接近先进制程芯片的综合性能。

如果这一方向能够持续推进，未来芯片竞争可能不再只是：

“谁的制程更先进”

而会逐渐转向：

“谁的系统协同效率更高”

四、行业观点：支持与质疑并存

目前，围绕“韬定律”，行业内存在两种主要观点。

支持观点

支持者认为：

后摩尔时代确实需要新的性能提升路径

延迟优化与系统协同是未来趋势

华为提出的方向符合当前产业发展逻辑

他们认为：

这是一种“以设计补工艺”的现实路线。

谨慎观点

也有观点认为：

降低时延本就是芯片设计长期追求的目标

3D 堆叠与先进封装并非全新概念

“韬定律”更像是对现有技术趋势的重新定义

同时，相关方案未来仍可能面临：

散热问题

功耗控制

制造良率

工程复杂度

等现实挑战。 大师兄影视

五、总结

“韬（τ）定律”是否会成为真正意义上的行业“定律”，目前仍有待长期验证。

但可以确定的是：

半导体产业正在从“单纯缩小尺寸”逐步转向“系统级效率优化”。

而“降低时延、强化协同、提升整体效率”，也正在成为后摩尔时代的重要发展方向之一。

无论最终名称如何，这场从“拼制程”到“拼系统”的转变，已经开始。